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基于HEVC的CABAC二进制算术编码器的FPGA实现

王尧, 汤心溢

王尧, 汤心溢. 基于HEVC的CABAC二进制算术编码器的FPGA实现[J]. 红外技术, 2020, 42(4): 335-339,347.
引用本文: 王尧, 汤心溢. 基于HEVC的CABAC二进制算术编码器的FPGA实现[J]. 红外技术, 2020, 42(4): 335-339,347.
shu
WANG Yao, TANG Xinyi. FPGA Implementation of CABAC Binary Arithmetic Encoder Based on HEVC[J]. Infrared Technology , 2020, 42(4): 335-339,347.
Citation: WANG Yao, TANG Xinyi. FPGA Implementation of CABAC Binary Arithmetic Encoder Based on HEVC[J]. Infrared Technology , 2020, 42(4): 335-339,347.
shu

基于HEVC的CABAC二进制算术编码器的FPGA实现

  • 中国科学院上海技术物理研究所中国科学院红外探测与成像技术重点实验室,上海 200083;中国科学院大学,北京 100049;上海科技大学信息科学与技术学院,上海 201210

  • 中国科学院上海技术物理研究所中国科学院红外探测与成像技术重点实验室,上海 200083;上海科技大学信息科学与技术学院,上海 201210

详细信息

  • 中图分类号: TN919.81

FPGA Implementation of CABAC Binary Arithmetic Encoder Based on HEVC

摘要

    摘要
  • 摘要: 本文基于H.265/HEVC视频编码标准,实现了CABAC编码中二进制算术编码器常规编码模式下的一种硬件流水线结构,根据算法特性设计并优化了编码器的硬件架构,将概率状态数据储存在SRAM中,并使用查找表优化概率估计更新运算;对编码数据进行打包处理,简化概率估计更新带来的计算,以优化视频数据流编码速度;二进制算术编码采用多级流水线结构,支持四路并行编码.仿真结果表明,本文的硬件CABAC二进制算术编码器平均每时钟周期可以完成4个bin的编码,符合较高帧率的1080p视频实时编码要求.
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